研究報告
DRAM市場快訊：打破AI伺服器記憶體牆之CXL2.0/3.0架構與生態升級
- 半導體 » DRAM
- 2026/08/26
2026年8月DRAM市場快訊
摘要
受惠 AI 伺服器需求爆發，HBM3e 與 HBM4 成為記憶體三大原廠產能配置核心。高層數 TSV 封裝與先進 DRAM 製程吞噬大量晶圓產能，導致傳統 DDR5/LPDDR5X 供給產生結構性緊縮，推升合約價格並加速產業進入新一輪上升週期。
內容
各大原廠積極轉向 HBM3e/HBM4 與先進節點製程，高層數堆疊技術大幅消耗晶圓投片量，進而擠壓傳統標準型 DRAM 產能釋放，引發市場供需平衡重組。
重點摘要
· HBM3e/HBM4 主導地位：AI 算力晶片迭代加速，HBM3e 12-Hi 與 HBM4 成原廠獲利與資本支出核心。
· 晶圓產能排擠效應：HBM 晶粒面積與 TSV 封裝消耗量為傳統 DRAM 的 2.5 至 3 倍，排擠 DDR5 產能釋放。
· 記憶體價格結構走揚：產能緊縮帶動 DDR5 及 LPDDR5X 合約價保持上升走勢，拉升原廠營業利益率。
· 次世代技術演進：HBM4 導入底層邏輯晶圓（Base Die）先進製程，記憶體與晶圓代工生態界線日趨模糊。
一、AI 伺服器記憶體牆（Memory Wall）與 CXL 破局
儘管 HBM 提供高達數 TB/s 的極致頻寬，但其高昂成本與通道數量限制使得伺服器整體記憶體容量擴充面臨瓶頸。為了解決 AI 大模型訓練與海量資料庫運算的『記憶體牆』問題，CXL（Compute Express Link）開放式互連標準正快速躍居資料中心次世代記憶體架構主流。CXL 2.0/3.0 規範透過 PCIe 介面實現 DRAM 記憶體池化（Memory Pooling）與共享，大幅提升伺服器記憶體利用率。
二、CXL 記憶體擴充控制晶片與台灣IC設計生態卡位
CXL 技術的核心在於 CXL 記憶體控制器（CMM / CXL Memory Controller）晶片。Samsung、SK Hynix 與 Microchip、Astera Labs 等業者積極推出了 CXL 2.0 記憶體擴充模組（CMM-D），並搭配 DDR5 顆粒實現插槽級容量擴充。台灣 IC 設計業者（如群聯、聯發科、點序）與 IC 封測廠（日月光、京元電）亦深耕 CXL 控制器與高階測試技術，構建非原廠專屬的 CXL 生態圈。
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CXL 技術規格演進 |
基礎匯流排介面 |
核心功能與記憶體架構突破 |
主要資料中心應用場景 |
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CXL 1.1 / 2.0 |
PCIe 5.0 (32 GT/s) |
支援記憶體擴充 (Memory Expansion) 與池化 (Pooling) |
單一伺服器記憶體容量倍增、資料庫加速 |
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CXL 3.0 / 3.1 |
PCIe 6.0 (64 GT/s) |
支援多節點直接共享記憶體 (Memory Sharing) 與微網拓樸 |
超大規模 AI 叢集、跨節點零拷貝大模型運算 |
表一：CXL 規範演進與記憶體池化架構比較（匯智洞見整理）
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供應鏈環節 |
國際領導業者 |
台灣代表性卡位業者 |
台廠技術戰略與競合優勢 |
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CXL 控制器 IC 設計 |
Astera Labs, Microchip, Rambus |
群聯 (Phison), 聯發科, 點序 |
發揮 PCIe 控制器設計經驗，提供低延遲高 CP 值 CXL 控制晶片 |
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CXL 記憶體模組組裝 |
Samsung, SK Hynix, Micron |
威剛, 創見, 勤誠 (Server 伺服器機殼) |
搭配 DDR5 顆粒提供客製化 CMM 模組與伺服器機櫃整合 |
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高階 CXL 測試與封裝 |
ASE Group, Amkor |
日月光, 京元電, 矽格 |
提供高頻高通道 CXL 控制器與記憶體模組自動化測試 |
表二：全球 CXL 記憶體生態系美日台競合分工表（匯智洞見整理）
三、匯智洞見
CXL 正成為打破 AI 伺服器『記憶體容量牆』的終極戰略武器。HBM 解決了高頻寬問題，而 CXL 則完美解決了高容量與低成本池化的問題。隨著 Intel 與 AMD 次世代伺服器平台全面原生支援 CXL 2.0/3.0，CXL 記憶體擴充模組需求將在 2026 至 2027 年迎來爆炸性成長。台灣 IC 設計與封測業者應緊扣 CXL 控制晶片與高頻測試技術，與記憶體原廠形成補位，搶占資料中心記憶體池化革命的最佳戰略位置。
